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Grenoble INP
Se former tout au long de sa vie
Un seul objectif : l'évolution des compétences
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Circuits numériques : conception en VHDL pour cible FPGA

Mis à jour le 1 décembre 2017
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Présentation

  • Ville : GRENOBLE
    Tarif : 2 300 € / personne
    Durée : 4 jours
  • Prochaine(s) session(s) :
    • Du 19/06/2018 au 22/06/2018

Résumé

Mce01

Objectifs


• Comprendre les étapes de conception d’architectures numériques portables pour cible FPGA
• Apprendre une méthodologie de conception VHDL pour cibles FPGA
• Acquérir des compétences en conception VHDL : comprendre l’importance des phases de synthèse des architectures


Nos atouts pédagogiques

Cette formation s’appuie sur les moyens techniques que met à disposition l’école Grenoble INP-Phelma, en particulier pour sa filière SEI « Systèmes Electroniques Intégrés » .
Les intervenants sont des enseignants-chercheurs et chercheurs du laboratoire TIMA, spécialistes reconnus dans le domaine de la conception de circuits et architectures numériques.

 

Les plus de la formation :


• une alternance entre apports théoriques et applications pratiques : 75% de la formation se déroule sous forme pratique en binôme au sein de la plateforme CIME
• plus de la moitié de la formation se déroule sous forme de travaux pratiques avec des études de cas sur ordinateurs équipés d'outils de CAO électronique de simulation et de synthèse(*)

(*) La formation s’appuie en particulier sur l’offre FPGA Xilinx

                                          

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Admission

  • Ville : GRENOBLE
  • Tarif : 2 300 € / personne

Conditions d'admission


Personnes concernées

Cette formation s'adresse à des ingénieurs ou techniciens souhaitant implanter des applications sur cibles FPGA.

Pré-requis : notions de logique combinatoire et séquentielle (niveau Bac + 3 ou équivalent)

Si vous avez déjà de bonnes bases en conception VHDL, le stage « Circuits numériques VLSI : conception avancée en VHDL pour cible FPGA/ASIC» est sans doute plus adapté pour vous.

Effectif : 4 à 8 personnes

Contacts

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Programme

  • Durée des études : 4 jours

Programme


1- Flot de conception

• Méthodologie de conception
• Décomposition modulaire

2- Le langage VHDL pour la synthèse
• Types
• Unités de conception
• Simulation évènementielle
• Instructions séquentielles et concurrentes
• Descriptions structurelles et comportementales
• Les règles de design VHDL pour la synthèse
• Description des machines à états en VHDL
• Librairies IEEE

3- Les composants programmables
• CPLD / FPGA : bases des architectures et de la programmation d’un composant programmable
• Prise en main d'un outil de simulation
• Prise en main d'un outil de synthèse VHDL
• Prise en main d'un outil de prototypage sur FPGA
• Programmation d'une cible FPGA et test

Exemples de notions abordées lors des séances de travaux pratiques :
• approfondissement par des exemples de conception d'architectures VHDL,
• synthèse logique et programmation de FPGA, de Xilinx,
• implantation d’un filtre numérique FIR et test sur carte en environnement réel


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International

  • Stage à l'étranger : Non
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Débouchés

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Rédigé par Katia Plentay

mise à jour le 1 décembre 2017

Contact et inscription

Katia Plentay
04 76 57 45 03
formation-continue.stages(a)grenoble-inp.fr

télécharger le bulletin d'inscription

Communauté Université Grenoble Alpes
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